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H.264中CABAC编码器的电路结构设计

许超  王伟  王文涛  
【摘要】:本文提出了一种用于H.264视频压缩标准的自适应二进制算术编码器的电路结构,该电路采用6级流水线结构,优化了值的更新和重整过程,设计了有效的封装输出模块。经Verilog HDL 实现并由Synopsys DC综合所得数据表明,与现有最好的结构相比,本结构的速度提高15%,面积减少10%,在0.18微米CMOS工艺下,其工作频率可以达364MHz。

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