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安全散列算法的FPGA研究

魏东梅  李艳  
【摘要】:安全散列算法的运算位数与运算的轮数较多,用硬件实现需耗费大量的资源。本文提出采用一种将寄存器时分复用的方式,并根据算法输入信号的特性来重新定义消息分组,能够节省 FPGA 资源,通过硬件描述语言 VHDL 作为设计输入,采用 ANSI X9.62-1998中的一组测试向量,使用 modsim 进行仿真,验证其实现功能正确,并采用 Xilinx Vertex 系列的 XC2V1000进行逻辑综合,其实现的数据吞吐量能够达到215M/s。

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