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《卫星通信技术研讨会论文集》2004年
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高速VITERBI译码器的研究与实现

刘会红  
【摘要】:随着纠错编码理论研究的不断深入,纠错码的实际应用越来越广泛。卷积码作为其中重要的一种,已被大多数通信系统所采用,并应用在各种场合。(2,1,7)卷积码是一种短约束长度最佳码,编、译码器易于实现,且具有较强的纠错能力。本文研究了(2,1,7)卷积码的软判决高速Viterbi译码的理论和实现问题,在此基础上实现了3/4删余码的Viterbi译码器,主要解决了高速实现时的时序问题和译删余码时的同步问题。首先介绍了Viterbi译码算法的新进展;借鉴国外已采用的将低速率的编译码器并行处理以得到高速率的编译码器的思想,设计了速率可变、码率可选的(1/2,3/4)卷积码的Viterbi译码器,并下载到Xilinx公司的Virtex-Ⅱ系列的FPGA器件上,经过时序仿真和实测,四路并行处理的Viterbi译码器速率可达到300Mbit/s,并测试了译码器的性能。
【分类号】:TN911.22

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【参考文献】
中国期刊全文数据库 前1条
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【共引文献】
中国硕士学位论文全文数据库 前2条
1 刘会红;高速Viterbi译码器的研究与实现[D];哈尔滨工程大学;2004年
2 钟福松;高密度光盘Viterbi译码器的FPGA设计与实现[D];华中科技大学;2007年
【相似文献】
中国期刊全文数据库 前10条
1 刘杨;章敏;;基于FPGA的卷积编译码器的设计与实现[J];电子设计工程;2010年08期
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中国重要会议论文全文数据库 前10条
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