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零延时MQ解码器的VLSI优化实现

于慧荣  姜宏旭  王元鹏  
【摘要】:MQ解码流程中存在部分数据依赖、判断及循环等操作问题,本文采用及时的概率估值更新、快速的字节并行读入、明确的解码器初始化以及化简的解码操作及区间计算、改进的移位位数检测、更新的解码区间重整判断等策略,设计了一种零延时MQ解码器,极大压缩了位平面解码的等待时间。设计使用Verilog语言进行RTL级描述,并在FPGA上进行了功能验证。实验结果表明,改进后的算法能够在一个时钟周期内完成从获取上下文到解码出符号的操作,解码效率提高40%,面积减少4%。

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